FPGA & Digital Design Engineer | RTL, VHDL, Python

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Akronos Technologies Group cerca un/a FPGA/Digital Design Engineer con robusto passione per la progettazione digitale, anche neolaureato/a in Ingegneria Elettronica o Telecomunicazioni. Lavorerai su RTL development, simulazione e testing, utilizzando VHDL, Python e Git in un contesto di telecomunicazioni.

La posizione è a Monza e Brianza, Lombardia. Richiesta Laurea in Ingegneria Elettronica o Telecomunicazioni e competenze in VHDL, Python e SystemVerilog.

#J-18808-Ljbffr

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