Hardware Test
Pubblicato il 12-08-2026 - Linkedin in Medolago
Unisciti ad AYES e fai la differenza
La descrizione completa del lavoro illustra tutte le competenze, l'esperienza pregressa e le qualifiche che i candidati dovrebbero possedere.
AYES, multinazionale leader nella consulenza ingegneristica e tecnologica, in ottica di continua espansione in Italia e all'estero, è alla ricerca di un Hardware Test & Design Engineer da inserire all'interno di un team R&D; presso un importante cliente operante in un contesto industriale altamente innovativo e focalizzato sull'elettrificazione.
Operiamo a livello globale nei settori più innovativi dell'industria: Automotive, Aerospazio e Difesa, Ferroviario, Energia, Oil&Gas;, Life Sciences e Telecomunicazioni. Con sedi in Italia, Europa e Stati Uniti, supportiamo i nostri clienti con competenze ingegneristiche di eccellenza, affrontando sfide complesse e promuovendo l'innovazione in ogni ambito.
Ricerchiamo nuovi talenti con una robusto passione per il mondo Industry.
Sei ambizioso e motivato a sviluppare le tue competenze in un ambiente altamente tecnologico e innovativo? Questa è l'opportunità perfetta per te
Responsabilità principali:
- Pianificazione ed esecuzione di test hardware e validazione di schede ed elementi elettronici.
- Simulazione di circuiti elettronici tramite software dedicati (es. SPICE / PSpice).
- Analisi e validazione di protocolli di comunicazione industriali e di veicolo.
- Utilizzo di strumentazione da laboratorio (oscilloscopi, multimetri, generatori di funzioni) per il debugging HW.
- Analisi dei requisiti tecnici e redazione della documentazione di test e dei report di validazione.
- Collaborazione con team cross-functional (R&D;, Qualità, Produzione) per l'ottimizzazione del prodotto.
Requisiti:
- Laurea Magistrale in Ingegneria Elettronica o discipline affini.
- Competenze consolidate nel testing hardware e nella validazione di circuiti elettronici.
- Ottima conoscenza di tool di simulazione circuitale (SPICE o similari).
- Familiarità con i principali protocol
