AMS Verification & Modeling Engineer (SystemVerilog RNM)

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Il candidato ideale ha una laurea in Ingegneria Elettronica, conoscenze di SystemVerilog e deve essere esperto nella verifica di circuiti analogici e mixed-signal. xysqume

La posizione offre una retribuzione annuale compresa tra 55.000 EUR e 65.000 EUR, a seconda dell'esperienza e competenze del candidato.

#J-18808-Ljbffr

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