Senior Soc Verification Engineer - Systemverilog/Uvm

29 ago - Napoli
st

ST assume una posizione di Senior Digital Verification Engineer – SoC a Napoli.
Il candidato lavorerà su testbench SystemVerilog UVM, sviluppando test in C e script Python per automazione, analisi e coverage.
Collaborerà con team RTL, architettura e firmware per definire strategie di verifica e garantire qualità elevata in ambienti automobilistici/industriali.
Viene richiesto un background in ingegneria elettronica o informatica, 5–8 anni di esperienza, conoscenza di tool EDA e ambienti

Electrical Engineer / Project Engineer

01 set - Pavia
Photon Power Renewable Energy

Addetto/Addetta Al Magazzino Amazon Alessandria Trn3

01 set - Canneto Pavese
Gigroup

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Addetto Al Magazzino - €22.000 All'Anno

01 set - Sant'Ambrogio di Torino
Eurointerim

Business Manager F/H

01 set - Italia
ADVANS Group