Aerospace FPGA Engineer - VHDL/Verilog (Rome)

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pALTEN Italia cerca un FPGA Engineer per importanti aziende nel settore Aerospazio e Difesa, con laurea in Ingegneria Elettronica e comprovata esperienza in progettazione digitale su FPGA utilizzando VHDL e Verilog. /ppLa sede è a Roma, la retribuzione annua lorda prevista è tra 35.000 e 45.000 EUR, inserita nel CCNL del commercio e terziario; avanzamenti e valutazioni basati su competenze tecniche ed esiti di selezione. /p #J-18808-Ljbffr

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