Senior Soc Verification Engineer - Systemverilog/Uvm

13 set - Sant'Antonio Abate
st

ST assume una posizione di Senior Digital Verification Engineer – SoC a Napoli. Il candidato lavorerà su testbench SystemVerilog UVM, sviluppando test in C e script Python per automazione, analisi e coverage.
Collaborerà con team RTL, architettura e firmware per definire strategie di verifica e garantire qualità elevata in ambienti automobilistici/industriali. Viene richiesto un background in ingegneria elettronica o informatica, 5–8 anni di esperienza, conoscenza di tool EDA e ambienti
#J-*****-Ljbffr

Assistente Personale

16 set - Corsico
Cantine

Co-Market Team Manager

16 set - Cascina
Technoform

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Junior Business Developer

16 set - Balgano
Concentrix

Business Development

16 set - Torino
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