FPGA Engineer: RTL Design & VHDL/Verilog

18 set - Frigento
AYES - Management & Technology Consulting

AYES
Se desidera conoscere i requisiti per questo ruolo, continui a leggere per trovare tutte le informazioni pertinenti.
- Management & Technology Consulting cerca un FPGA ENGINEER per contribuire a progetti avanzati di elettronica e digital design.
Il ruolo prevede progettazione FPGA in VHDL/Verilog, sviluppo RTL e integrazione con sistemi hardware e firmware in un contesto tecnologicamente avanzato.

Si richiede laurea in Ingegneria Elettronica/Telecomunicazioni, esperienza con flussi FPGA e conoscenza di Vivado o Quartus. xysqume
Ottima conoscenza dell'inglese e predisposizione al lavoro in team.

#J-18808-Ljbffr

Impiegato del back office

19 set - Roma
agap2 Italia

Addetto/A Sala | Old Wild West | Brescia Oz - €8,2 All'Ora - Part Time...

19 set - Rezzato
OLD WILD WEST

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Mechanic Technician (f/m/nb)...

19 set - Brescia
Randstad Inhouse

Chef De Partie Hotel 4 Stelle - €25.000 All'Anno

19 set - Bresso
AXL