FPGA Design Engineer: RTL, IP Integration & Prototyping

30 set - Lazio
Dedagroup

Dedagroup, tramite Deda Connect, cerca una figura per lo sviluppo e verifica di FPGA a Roma o Milano. Progetti in infrastrutture IP, sistemi embedded e reti complesse richiedono competenze in HDL e integrazione IP, anche su SoC.

Responsabilità includono scrittura RTL, integrazione IP, test su scheda e redazione di documentazione tecnica. Laurea in ingegneria, conoscenza di VHDL/Verilog e strumenti di sviluppo come Quartus o Vivado sono fondamentali.

#J-18808-Ljbffr

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Ernesto

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Ernesto

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30 set - Lariano
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