FPGA Designer: RTL/Verilog, IP Integration & Verification

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pDedagroup, con Deda Connect, cerca un ingegnere FPGA per progettare e verificare soluzioni IP complesse a Milano/Roma. Lavorerai sulla codifica RTL, l’integrazione IP e la validazione su scheda. /ppIl ruolo richiede laurea in ingegneria e competenze in VHDL/Verilog, strumenti FPGA e una base in C/C++. Modello di lavoro agile e possibilità di crescita e certificazione interne sono offerti. /p #J-18808-Ljbffr

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