Fpga Designer: Rtl/Verilog, Ip Integration & Verification

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Dedagroup, con Deda Connect, cerca un ingegnere FPGA per progettare e verificare soluzioni IP complesse a Milano/Roma.Il suo CV è pronto? Se sì, e se è convinto/a che questo sia il ruolo giusto per lei, si candidi il prima possibile.Lavorerai sulla codifica RTL, l’integrazione IP e la validazione su scheda.Il ruolo richiede laurea in ingegneria e competenze in VHDL/Verilog, strumenti FPGA e una base in C/C++. xysqume Modello di lavoro agile e possibilità di crescita e certificazione interne sono offerti.#J-18808-Ljbffr

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