Senior Analog IC Layout Engineer - Transistor-Level Design

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Move Silicon è la business unit di Move S.p.A. dedicata allo sviluppo di soluzioni ASIC e SoC ad alta efficienza per applicazioni industriali, automotive e IoT. Lavoriamo in stretta collaborazione con clienti globali per portare sul mercato dispositivi analogici e mixed-signal innovativi, con un forte focus sull’affidabilità e sulla sostenibilità dei nostri progetti. Move Silicon è la business unit di Move S.p.A. dedicata allo sviluppo di soluzioni ASIC e SoC ad alta efficienza per applicazioni industriali, automotive e IoT.

Lavoriamo in stretta collaborazione con clienti globali per portare sul mercato dispositivi analogici e mixed-signal innovativi, con un forte focus sull’affidabilità e sulla sostenibilità dei nostri progetti. Cerchiamo un/una Senior Analog IC Layout Engineer Il profilo ideale ha esperienza consolidata su layout analogico qualificato, eccellente attenzione al dettaglio, autonomia nella gestione del sign-off e capacità di mentorship verso profili junior. Ownership del layout di blocchi analogici deep-submicron e BCD: amplificatori fully-differential, band-gap reference, regolatori di tensione, etc.

Definizione e applicazione di strategie di matching avanzato (common-centroid, interdigitazione, simmetrie), guard-ring, shielding e isolamento substrato, con focus su robustezza a PVT e accoppiamenti. Routing manuale di rete di alimentazione e segnali sensibili con minimizzazione di parassite R/C, couplage capacitivo e criticità di integrità (grounding, return paths, crosstalk).



Collaborazione stretta con analog circuit designer per iterazioni di layout-versus-schematic, ottimizzazione area/performance e gestione delle modifiche (ECO) fino a tape-out.

Contributo al miglioramento delle metodologie di layout e delle checklist interne (regole di stile, review template, best practice di matching/ESD/isolamento). Preparazione e validazione della documentazione di release (check-list, waiver, change-log) nel rispetto delle procedure di qualità interne. Partecipazione e conduzione di design review, con attività di mentorship/formazione continua su metodologia e tool CAD per risorse junior.

Laurea triennale/magistrale in Ingegneria Elettronica o affini ~≥ 5 anni di esperienza in layout analogico transistor-level su ASIC/SoC ~ Padronanza di design-rule, DRC/LVS e tecniche di matching dispositivi ~ Approccio rigoroso a precisione, ordine, documentazione e collaborazione di team Esperienza su nodi Script Skill/TCL/Python per automazione CAD e flussi di verifica Esperienza di mentoring e coordinamento tecnico di risorse junior Familiarità con review multi-disciplinari e interfaccia con stakeholder esterni Economics: tempo indeterminato CCNL Commercio RAL 44-60K (in base all'esperienza) + buoni pasto elettronici.

Crescita: mentorship strutturata con senior layout engineer, corsi EDA, partecipazione a conferenze (DATE, ISPD).

Benefit: bonus annuale legato ai risultati, mensa interna/buoni pasto, assicurazione sanitaria. Padova (ibrido). 13 del regolamento (UE) 2016/679 sulla protezione dei dati (GDPR). #

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